A funcionalidade de pesquisa está em construção.
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High-End Server Based on Complexity-Reduced Architecture for Superconductor Technology Servidor de última geração baseado em arquitetura de complexidade reduzida para tecnologia de supercondutores

Akira FUJIMAKI, Yoshiaki TAKAI, Nobuyuki YOSHIKAWA

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Resumo:

Apresentamos uma estrutura de design de um servidor topo de linha baseado em tecnologias de circuito Single-Flux-Quantum (SFQ). O servidor aqui proposto possui múltiplos microprocessadores e memórias, que são montados em uma única placa ou pacote e são conectados entre si por chaves de interconexão SFQ. A largura de banda extremamente grande de até 100 Gbps/canal na interconexão será realizada devido à natureza de alto rendimento dos circuitos SFQ. Memórias SFQ ou memórias híbridas Josephson-CMOS são empregadas como memória compartilhada do multiprocessador. Os microprocessadores SFQ são construídos com base na arquitetura de complexidade reduzida (CORE), na qual a complexidade do sistema é facilitada em troca do uso de uma alta taxa de clock dos circuitos SFQ. O processador é o chamado processador Java que executa diretamente os códigos de bytes Java. Assumindo um avanço adequado do Nb/AlOx/Nb tecnologia de processo de circuito integrado, estimamos que o consumo de energia do sistema de servidor incluindo um criocooler é reduzido por um fator de vinte em comparação com o futuro sistema CMOS com o mesmo desempenho de processador, enquanto o sistema SFQ tem 100 vezes de magnitude maior largura de banda do processador de memória.

Publicação
IEICE TRANSACTIONS on Electronics Vol.E85-C No.3 pp.612-616
Data de publicação
2002/03/01
Publicitada
ISSN online
DOI
Tipo de Manuscrito
Special Section INVITED PAPER (Special Issue on Superconductive Electronics)
Categoria
Dispositivos Digitais e Suas Aplicações

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