A funcionalidade de pesquisa está em construção.
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A Power-Efficient Pulse-VCO for Chip-Scale Atomic Clock Um Pulse-VCO com eficiência energética para relógio atômico em escala de chip

Haosheng ZHANG, Aravind THARAYIL NARAYANAN, Hans HERDIAN, Bangan LIU, Rui WU, Atsushi SHIRANE, Kenichi OKADA

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Resumo:

Este artigo apresenta um VCO de pulso de alta eficiência energética com filtro traseiro para a aplicação de relógio atômico em escala de chip (CSAC). As rigorosas especificações de potência e estabilidade de clock do CSAC de próxima geração exigem um VCO com consumo de energia ultrabaixo e baixo ruído de fase. A arquitetura VCO proposta visa alta eficiência energética, ao mesmo tempo em que reduz ainda mais o ruído de fase usando a técnica de filtragem de cauda. O VCO foi implementado em uma tecnologia SOI padrão de 45 nm para validação. A uma frequência de oscilação de 5.0 GHz, o VCO proposto atinge um ruído de fase de -120 dBc/Hz com deslocamento de 1 MHz, enquanto consome 1.35 mW. Isso se traduz em um FoM de -191dBc/Hz.

Publicação
IEICE TRANSACTIONS on Electronics Vol.E102-C No.4 pp.276-286
Data de publicação
2019/04/01
Publicitada
ISSN online
1745-1353
DOI
10.1587/transele.2018CDP0010
Tipo de Manuscrito
Special Section PAPER (Special Section on Solid-State Circuit Design — Architecture, Circuit, Device and Design Methodology)
Categoria

autores

Haosheng ZHANG
  Tokyo Institute of Technology
Aravind THARAYIL NARAYANAN
  Tokyo Institute of Technology
Hans HERDIAN
  Tokyo Institute of Technology
Bangan LIU
  Tokyo Institute of Technology
Rui WU
  Tokyo Institute of Technology
Atsushi SHIRANE
  Tokyo Institute of Technology
Kenichi OKADA
  Tokyo Institute of Technology

Palavra-chave