A funcionalidade de pesquisa está em construção.
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Look Up Table Compaction Based on Folding of Logic Functions Compactação de tabela de consulta com base na dobragem de funções lógicas

Shinji KIMURA, Atsushi ISHII, Takashi HORIYAMA, Masaki NAKANISHI, Hirotsugu KAJIHARA, Katsumasa WATANABE

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Resumo:

O artigo descreve o método de dobramento de funções lógicas para reduzir o tamanho das memórias para manter as funções. A dobragem é baseada na relação de frações de funções lógicas. Se a função lógica incluir 2 ou 3 partes iguais, apenas uma parte deverá ser mantida e outras partes poderão ser omitidas. Mostramos que a função lógica de adição de 1 bit pode ser reduzida à metade do tamanho usando a relação NOT bit a bit e a relação OR bit a bit. O artigo também apresenta LUTs 3-1 com mecanismo de dobramento. Um somador completo pode ser implementado usando apenas uma LUT 3-1 com dobramento. Operações AND e OR de vários bits podem ser mapeadas para nossos LUTs, não usando o circuito extra em cascata, mas usando o circuito de transporte para adição. Também testamos a capacidade de mapeamento de 4 funções de entrada para nossos LUTs 3-1 com mecanismos de dobramento e propagação de transporte. Mostramos a redução do consumo de área ao usar nossas LUTs em comparação ao caso usando LUTs 4-1 em vários circuitos de benchmark.

Publicação
IEICE TRANSACTIONS on Fundamentals Vol.E85-A No.12 pp.2701-2707
Data de publicação
2002/12/01
Publicitada
ISSN online
DOI
Tipo de Manuscrito
Special Section PAPER (Special Section on VLSI Design and CAD Algorithms)
Categoria
Síntese Lógica

autores

Palavra-chave