A funcionalidade de pesquisa está em construção.
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Phase Locking Value Calculator Based on Hardware-Oriented Mathematical Expression Calculadora de valor de bloqueio de fase baseada em expressão matemática orientada a hardware

Tomoki SUGIURA, Jaehoon YU, Yoshinori TAKEUCHI

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Resumo:

Um valor de bloqueio de fase (PLV) na eletrocorticografia é um indicador essencial para análise de atividades cognitivas e detecção de doenças graves, como crises de epilepsia. A computação PLV requer uma busca simultânea por implementação de alto rendimento e baixo custo em aceleração de hardware. O cálculo do PLV consiste em filtragem passa-banda, transformada de Hilbert e cálculo de coerência média de fase (MPC). O cálculo MPC inclui funções e divisões trigonométricas, e esses cálculos exigem muitos valores computacionais. Este artigo propõe um método de cálculo MPC que remove operações de alto custo do MPC original com derivações matematicamente idênticas, enquanto os métodos convencionais sacrificam a precisão computacional ou o rendimento. Este artigo também propõe uma implementação de hardware da calculadora MPC cuja latência é de 21 ciclos e o intervalo do pipeline é de cinco ciclos. Em comparação com a implementação convencional com a mesma biblioteca de células padrão, a implementação proposta apresenta uma eficiência de implementação de hardware 2.8 vezes melhor, definida como taxa de transferência por contagem de portas.

Publicação
IEICE TRANSACTIONS on Fundamentals Vol.E101-A No.12 pp.2254-2261
Data de publicação
2018/12/01
Publicitada
ISSN online
1745-1337
DOI
10.1587/transfun.E101.A.2254
Tipo de Manuscrito
Special Section PAPER (Special Section on VLSI Design and CAD Algorithms)
Categoria

autores

Tomoki SUGIURA
  the Graduate School of Osaka University
Jaehoon YU
  the Graduate School of Osaka University
Yoshinori TAKEUCHI
  the Graduate School of Osaka University

Palavra-chave