A funcionalidade de pesquisa está em construção.
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Conversion from Synchronous RTL Models to Asynchronous RTL Models Conversão de modelos RTL síncronos para modelos RTL assíncronos

Shogo SEMBA, Hiroshi SAITO

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Resumo:

Neste artigo, para facilitar o projeto de circuitos assíncronos, propomos um método de conversão de modelos síncronos de nível de transferência de registro (RTL) para modelos RTL assíncronos com implementação de dados agrupados. O método proposto consiste na geração de uma representação intermediária a partir de um determinado modelo RTL síncrono e na geração de um modelo RTL assíncrono a partir da representação intermediária. Isso nos permite lidar com diferentes estilos de representação de modelos RTL síncronos. Usamos a eXtensible Markup Language (XML) como representação intermediária. Além do modelo RTL assíncrono, o método proposto gera um modelo de simulação quando a implementação alvo é um Field Programmable Gate Array e um conjunto de restrições de não otimização para o circuito de controle usado na síntese lógica e síntese de layout. No experimento, demonstramos que o método proposto pode converter modelos RTL síncronos especificados manualmente e obtidos por uma ferramenta de síntese de alto nível em modelos assíncronos.

Publicação
IEICE TRANSACTIONS on Fundamentals Vol.E102-A No.7 pp.904-913
Data de publicação
2019/07/01
Publicitada
ISSN online
1745-1337
DOI
10.1587/transfun.E102.A.904
Tipo de Manuscrito
Special Section PAPER (Special Section on Design Methodologies for System on a Chip)
Categoria

autores

Shogo SEMBA
  the University of Aizu
Hiroshi SAITO
  the University of Aizu

Palavra-chave