A funcionalidade de pesquisa está em construção.
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Design of an Area-Efficient and Low-Power Hierarchical NoC Architecture Based on Circuit Switching Projeto de uma arquitetura NoC hierárquica com eficiência de área e baixo consumo de energia baseada em comutação de circuitos

Woo Joo KIM, Sung Hee LEE, Sun Young HWANG

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Resumo:

Este artigo apresenta uma arquitetura NoC hierárquica para suportar sinais GT (Guaranteed Throughput) para processar dados multimídia em sistemas embarcados. A arquitetura fornece um ambiente de comunicação que atende às diversas condições de restrições de comunicação entre IPs em potência e área. Com um sistema baseado em comutação de pacotes, que requer circuitos de armazenamento/controle para suportar sinais GT, é difícil satisfazer as restrições de projeto em área, escalabilidade e consumo de energia. Este artigo propõe uma hierarquia 44Arquitetura NoC tipo malha 4 baseada em comutação de circuitos, que é capaz de processar sinais GT que exigem alto rendimento. A arquitetura NoC proposta apresenta redução na área em 50.2% e no consumo de energia em 57.4% em comparação com a arquitetura NoC convencional baseada em comutação de circuitos. Estes números ascendem a 72.4% e a 86.1%, quando comparados com uma arquitetura NoC baseada em comutação de pacotes. A arquitetura NoC proposta opera na taxa de transferência máxima de 19.2 Gb/s.

Publicação
IEICE TRANSACTIONS on Fundamentals Vol.E92-A No.3 pp.890-899
Data de publicação
2009/03/01
Publicitada
ISSN online
1745-1337
DOI
10.1587/transfun.E92.A.890
Tipo de Manuscrito
PAPER
Categoria
Tecnologia de Design VLSI e CAD

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Palavra-chave