A funcionalidade de pesquisa está em construção.
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HDLs Modeling Technique for Burst-Mode and Extended Burst-Mode Asynchronous Circuits Técnica de modelagem de HDLs para circuitos assíncronos de modo burst e modo burst estendido

Jung-Lin YANG, Jau-Cheng WEI, Shin-Nung LU

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Resumo:

Uma técnica de modelagem baseada em linguagens de descrição de hardware (HDLs) para circuitos assíncronos é apresentada neste artigo. Um pacote de handshake HDLs foi desenvolvido para expressar sistemas digitais no estilo handshake em VHDL e Verilog. Circuitos de modo burst e modo burst estendido (BM/XBM) foram usados ​​para demonstrar a utilidade deste trabalho. Esta pesquisa prototipou com sucesso comparadores, somadores, codificador/decodificador RSA e vários circuitos auto-temporizados para projetos de IC e FPGAs totalmente personalizados. Além disso, o pacote de handshake de HDLs implementado por esta pesquisa pode ser utilizado para desenvolver bancos de testes comportamentais para estudar e analisar projetos assíncronos. A extração de informações detalhadas de temporização de máquinas de estado finito assíncronas (AFSMs), a detecção de falhas de atraso para módulos funcionais auto-temporizados sintetizados e a localização de violação de modo fundamental em AFSMs realizados são aplicações comprovadas. A técnica antecipada de modelagem de HDL e o procedimento de transformação são detalhados no restante deste artigo.

Publicação
IEICE TRANSACTIONS on Fundamentals Vol.E93-A No.12 pp.2590-2599
Data de publicação
2010/12/01
Publicitada
ISSN online
1745-1337
DOI
10.1587/transfun.E93.A.2590
Tipo de Manuscrito
Special Section PAPER (Special Section on VLSI Design and CAD Algorithms)
Categoria
Síntese de alto nível e design de nível de sistema

autores

Palavra-chave